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A Intel planeja lançar a próxima geração de processadores Arrow Lake em 2024. P-Core e E-Core serão atualizados para as novas arquiteturas Lion Cove e Skymont, respectivamente. Arrow Lake também se expandirá para múltiplas plataformas segmentadas, com “S” usado para desktops, pertencentes à série Core Ultra 200, permitindo que o novo soquete LGA 1851 substitua o soquete LGA 1700 existente.

Na foto: Pat Gelsinger, CEO da Intel, mostra wafers de Arrow Lake

Recentemente, alguns internautas revelaram que o Arrow Lake-S terá dois chips, ou seja, o "B0" do 8P+16E e o "C0" do 6P+8E. O display principal será equipado com até 4 núcleos Xe.

Os chips B0 são usados ​​principalmente no Core Ultra 9 e no Core Ultra 7. O primeiro tem uma configuração máxima de 8P+16E, enquanto o último tem uma configuração máxima de 8P+12E. Ambos fornecem 125W "K", 65W "non-K". e versões “T” de 35W O display principal está equipado com 4 núcleos Xe, e deve haver um modelo “F” sem display principal. A maior parte dos Core Ultra 5 possuem chips B0 e C0 coexistindo, com configuração máxima de 6P+8E (4Xe). Haverá também combinações de 6P+8E (3Xe), 6P+8E (0Xe) e 6P+4E (2Xe). ). No entanto, a versão "T" de 35 W não possui uma configuração 6P + 8E (0Xe) e os produtos de baixo consumo de energia usam apenas chips C0.

Além disso, além de Ultra 9 285K (8P+16E, 125W), Ultra 9 275 (8P+16E, 65W), Ultra 7 265K (8P+12E, 125W), Ultra 7 255 (8P+12E, 65W), Ultra 5 245K Exceto (6P+8E, 125W) e Ultra 5 240, os nomes específicos dos outros modelos ainda não foram determinados.

Há rumores de que em Arrow Lake-S, cada cluster E-Core da arquitetura Skymont (4 núcleos) é equipado com cache L2 de 4 MB (16 vias) e cache L3 de 3 MB, enquanto cada P-Core da arquitetura Lion Cove é equipado com 3 MB ( Cache L2 de 12 vias e 3 MB de cache L3. Ou seja, a configuração 8P + 16E mais alta será equipada com 40 MB de cache L2 e 36 MB de cache L3, totalizando 76 MB, o que é cerca de 12% a mais de cache do que os 68 MB do Raptor Lake-S.